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La comunidad científica involucrada con el cómputo del alto desempeño encuentra en el elevado consumo energético una barrera para el futuro de las plataformas HPC y su ruta hacia la era exascale, producto de ello se ha agrupado en eventos como \cite{ENAHPC:2014:Online} y \cite{ICS:2014:Online} entre otros, para plantear ideas de como atacar dicha problematica.  Muchos enfoques han sido considerados para dar solución a la problemática del consumo energético sobre las arquitecturas de alto rendimiento, y el consumo adicional que implica la integración de aceleradores y coprocesadores en ellas. Algunos estudios en la literatura como , \cite{Etinski_2010},  plantean el uso de la técnica de voltaje dinámico y escalamiento en frecuencia (DVFS) o sus variaciones, como una de las alternativas para mitigar el consumo energético desde el punto de vista del hardware. Sin embargo este escenario tienes como principal desventaja el aumento en los tiempos ejecución de las aplicaciones como lo expone Understanding the future of energy-performance trade-off via DVFS in HPC environments\cite{Etinski_2012}  Desde el punto de vista del software, los planteamientos van desde la propuesta de nuevos algoritmos para planificación de tareas o modificaciones de los ya existentes, hasta el desarrollo de nuevos lenguajes y modelos de programación paralelos como CUDA, OmpSs, OpenCL, Pthreads, para definir y controlar la forma en como las aplicaciones acceden y emplean los recursos de hardware que les permiten ejecutarse de manera acelerada.